| OPUSERイン/アンインストール、ライセンスマネージャイン/アンインストール |
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| OPUSER V 活用ガイド | |
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| OPUSER V 新機能について |
| オームの法則、分圧回路と DC スイープ解析、トランジスタの３つの端子(E,C,B)依存の確認と消費電力、コンデンサの充電 、周波数特性の確認、オペアンプ 非反転増幅回路、低周波数増幅回路、論理回路シミュレーション、デジタルシミュレーション、PCB 設計・ガーバーエクスポート・部品表作成 | |
| Introduction to VHDL in OPUSER: Creating Schematics diagrams from VHDL,creating MixedMode/Edspice simulator models. |
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| Full Adder VHDL code |
| EDSPICE Simulation Manual (English Version ) Simulation HandBook. (University of Kerala India, Trivandrum) |
| シミュレーション内容 |
解析手順
案内メモ
ダウンロード |
すぐ使えるOPUSER プロジェクトファイル ダウンロード |
| 例 1 DCスイープ解析 (LEDアニメーション・抵抗が消費電力計算） |
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| 例 2 過渡解析 (入力電圧振幅制限リミッタ回路) |
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| 例 3 過渡解析 (入力波形の一部を薄く切りとるスライサ回路) |
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| 例 4 パラメトリック解析 (コンデンサの充電 電圧波形) |
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| 例 5 反転増幅回路電圧増幅・信号の逆相の確認 (オペアンプ 反転増幅回路の解析) | |
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| 例 6 トランジスタ電流増幅率 (固定バイアス回路) |
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| 例 7 波形ひずみ・回路増幅度 (低周波増幅回路) |
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| 例 8 過渡解析 (タイマーＩＣLMC555使用昇圧DC-ACコンバータ回路 1.5V電池1本で白色LED点灯させる回路) | |
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| 例 9 基本的論理素子の動作確認 (デジタルシミュレーション) |
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| 例 10JK-FF同期式8進カウンタClockGenerator, LogicAnalyzer7セグメントLEDアニメーション (デジタルシミュレーション) | |
| 基板にビットマップ・ロゴ挿入 | |
| ベタ面の出力：ベタを含んだパターンのガーバーデータを出力 | |
| ベタ面の接続チェック、クリーンアップ | |
| メタルマスクデータ作成・出力 | |
| ガーバーデータ出力 | |
| 部品実装データの出力 | |
| その他のデータ出力 | |
| Idfデータ出力 |
ベタ領域作成方法と注意点、出力方法
OPUSER V. 新しいGND (グランド)シンボル作成例
OPUSER V. エッジ実装コネクタ部品作成例